铺完地铜皮跳Soldermask to Shape Spacing，先判断是不是Mark点误报，改规则最小值到…
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测过Cadence 17.4这个版本，在里面踩了无数有关设计规则设置方面的坑，尤其是那个能让人崩溃的DRC报错…
实测Altium Designer 21这个版本的人是我，在进行差分对等长调节的时候，我踩中了蛇形绕线卡顿以及…
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我测过了, Cadence 17.4版本，踩过那种会出现DRC报错进而刷屏并且金属间距怎么都调整不对情况的坑。…
我实际测过Cadence Allegro 17.4版本，在此过程中踩过电源网络加粗后出现短路以及DRC报错这些…
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以下这段经历发生在我身上，当时我实际测试了Calibre 2023.3版本，在进行批量DRC排查的时候，遭遇过…
自己实际测试了Allegro 17.2版本，遇到过最令人头疼的DRC报错情况，还有走线卡顿的问题。
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