这次是由我亲自进行了四层板高速CAN通信电路的实测, 过程中我遭遇过信号反射致使通信失败的状况, 对于新手而言, 只要依照步骤逐个进行操作
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我亲自进行了Cadence Allegro 17.4版本的实际测量, 遭遇了信号反射致使时钟抖动、蛇形线阻抗不连续这两个极为严重的问题, 新手只要依照下述步骤逐一来操作
我亲身进行了 Altium Designer 22 的测试, 用它来制作 4 层高速电路板, 在此过程中我遭遇了过孔反射以及阻抗不匹配引来信号眼图闭合的麻烦
本人实际测试 Cadence 17.4 版本, 遭遇过走线断裂的状况、面临过约束规则冲突的情况、碰到过动态铜皮报错这类新手高频出现的问题, 依照步骤一步步去进行操作
自己实际测试了Cadence 17.4 Allegro版本，经历过DRC（设计规则检查）报错怎么都运行不畅的困境对于刚入门跟着步骤逐个操作
我自身实际测试了Altium Designer 22.9这款软件，经历过像过孔DRC报错、丝印阻焊出现偏差这样实际操作中会遇到的难题，新手只要依照步骤一步步去开展操作
实测Synopsys V – 2023.03，实测Cadence 202209，实测国产礼动EDA V3.2，本人踩过许可证跳转丢失的实操坑点，踩过版图DRC批量误报的实操坑点
有过Altium Designer 22.6的实测经历，曾为默认线宽致使50欧姆阻抗偏差达30%而踩坑，新手只要依照步骤逐一操作，便可轻易避开这类常见问题。
本人以实际操作体验了Cadence 17.4以及Altium Designer 22，遭遇过原理图同步之后网表导入时始终报出“缺失封装”这一状况的困扰点