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**Published:** 2026-10-19T03:00:00

**Author:** 智行者IC社区

**Excerpt:** 整理Allegro DRC检查入口与错误代码对照表：对象码L/P/V/K、前置码W/D/M、后置码S/N/W，…

Allegro 跑完 DRC 满屏红字，光看代码根本不知道哪错了。这篇把检查入口和常用错误代码整理成对照表，遇到直接查。

### 检查入口

先 Display > Status 看整体状态。单项检查走 Tools > Quick Reports，常用三个：**Unconnected Pins Report**（没连上的引脚）、**Unplaced Components Report**（没放的元件）、**Design Rules Check Report**（DRC 明细）。覆铜相关 Shape > Global Dynamic Params，板层 Setup > Cross-section，最后 Tools > Database Check 全跑一遍，再回 Display > Status 复核。

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### 错误代码怎么读

Allegro 的 DRC 代码是”对象 + 前置 + 后置”拼出来的，先认对象：

-   **L** = Line 走线，**P** = Pin 元件脚，**V** = Via 过孔，**K** = Keep in/out 区域，**C** = Component，**E** = 电气约束，**J** = T 形走线，**I** = 负片孤铜。
-   前置码：**W**\=Wire 走线相关，**D**\=Design 整板，**M**\=Soldermask 防焊。
-   后置码：**S**\=Shape/Stub，**N**\=Not Allowed，**W**\=Width 宽度。

### 高频双字符代码

-   **LL** Line to Line：走线之间太近；**LW** 线宽太细；**LS** 走线与 Shape 太近。
-   **PP** Pin to Pin：焊盘之间太近（含 SMD/Through/Test 各种组合）；**PL** 走线与 SMD 脚太近。
-   **KB/KC/KL/KS/KV**：Bondpad、元件、走线、Shape、Via 落在 Keepin 外或 Keepout 内。
-   **DF** 差分对长度误差超差；**DI** 负片孤铜；**IM** 阻抗约束不满足；**EV** 过孔数量超限；**EX** 串扰超限。
-   **VV/VL/VS**：BBVia 之间、BBVia 与走线、BBVia 与 Shape 太近。

完整表里还有 HH（钻孔间距太近）、MM（防焊间距）、MA（防焊公差太小）、RC（元件落在别的 Room 里）等，遇到代码按”对象+前后置”拆解基本能定位。

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### 踩坑记录

-   **坑1：**改完约束管理器不重跑 Database Check，Status 里还是旧报错，白高兴——改完必重跑 DB Check 再看。
-   **坑2：**看到 LL 别慌，就是两根线间距不够，先量间距再调约束，别上来就删线。
-   **坑3：**负片层报 DI/IM 多半是孤铜或平面连接问题，去 Shape Islands 报告里找孤岛，别在走线里瞎找。

**Tags:** Allegro, Cadence, DRC, EDA工具, PCB设计, 设计规则检查

**Categories:** Allegro使用

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